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Logic circuit and single-electron spin transistor

外国特許コード F110003556
整理番号 BK05501WO
掲載日 2011年6月29日
出願国 アメリカ合衆国
出願番号 88656406
公報番号 20090039401
公報番号 07851877
出願日 平成19年12月28日(2007.12.28)
公報発行日 平成21年2月12日(2009.2.12)
公報発行日 平成22年12月14日(2010.12.14)
国際出願番号 PCT/JP2006/301744
国際公開番号 WO2006/100835
国際出願日 平成18年2月2日(2006.2.2)
国際公開日 平成18年9月28日(2006.9.28)
優先権データ
  • 特願2005-085260 (2005.3.24) JP
発明の名称 (英語) Logic circuit and single-electron spin transistor
発明の概要(英語) A logic circuit that can reconfigure its functions in a nonvolatile manner and a single-electron transistor to be used in the logic circuits are provided. The logic circuit has a single-electron spin transistor that includes: a source; a drain; an island that is provided between the source and the drain, and has tunnel junctions between the island and the source and drain; and a gate that is capacitively coupled to the island. In this logic circuit, at least one of the source, the drain, and the island includes a ferromagnetic material having a variable magnetization direction.
  • 発明者/出願人(英語)
  • Tanaka, Masaaki; Saitama [JP]
  • Sugahara, Satoshi; Kanagawa [JP]
  • Pham, Hai Nam; Tokyo [JP]
  • Japan Science and Technology Agency, Kawaguchi-Shi [JP]
国際特許分類(IPC)
米国特許分類/主・副
  • 257/421
  • 257/30
  • 257/295
  • 257/E29.323
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