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Data processing device for implementing instruction reuse, and digital data storage medium for storing a data processing program for implementing instruction reuse

外国特許コード F110005371
整理番号 K01902WO
掲載日 2011年9月5日
出願国 アメリカ合衆国
出願番号 59369505
公報番号 20080250232
公報番号 08055885
出願日 平成18年9月20日(2006.9.20)
公報発行日 平成20年10月9日(2008.10.9)
公報発行日 平成23年11月8日(2011.11.8)
国際出願番号 PCT/JP2005/005591
国際公開番号 WO2005/093562
国際出願日 平成17年3月25日(2005.3.25)
国際公開日 平成17年10月6日(2005.10.6)
優先権データ
  • 特願2004-097197 (2004.3.29) JP
  • 特願2004-266056 (2004.9.13) JP
  • 特願2004-324348 (2004.11.8) JP
  • 特願2004-347124 (2004.11.30) JP
発明の名称 (英語) Data processing device for implementing instruction reuse, and digital data storage medium for storing a data processing program for implementing instruction reuse
発明の概要(英語) A method and apparatus is provided for significantly speeding-up program execution in a data processing device. The data processing device is provided with a specialized instruction region storage section comprising content addressable memory (CAM) and random access memory (RAM) that operatively functions as an instruction sequence reuse table which is capable of registering/storing sequences of program instructions and corresponding instruction sequence output data as input/output (I/O) groups for potential future use in place of re-executing identical portions of program code. The data processing device includes at least one instruction stream processor which includes a computing unit for executing instructions and a dependency relationship analysis unit or "reuse window" unit (RW) that analyzes instruction sequence patterns from regions of instructions stored in a main memory to determine if the patterns can be divided up into smaller partitions that have no interdependencies and hence are potential candidates for reuse.
  • 発明者/出願人(英語)
  • Nakashima, Yasuhiko; Kyoto [JP]
  • Japan Science and Technology Agency, Saitama [JP]
国際特許分類(IPC)
米国特許分類/主・副
  • 712/225
  • 712/216
参考情報 (研究プロジェクト等) PRESTO Information Infrastructure and Applications AREA
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