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SEMICONDUCTOR STORAGE DEVICE

外国特許コード F140007872
整理番号 S2012-0660-C0
掲載日 2014年6月5日
出願国 世界知的所有権機関(WIPO)
国際出願番号 2013JP062791
国際公開番号 WO 2013168685
国際出願日 平成25年5月3日(2013.5.3)
国際公開日 平成25年11月14日(2013.11.14)
優先権データ
  • 特願2012-105558 (2012.5.6) JP
発明の名称 (英語) SEMICONDUCTOR STORAGE DEVICE
発明の概要(英語) A semiconductor storage device (1) includes an input control unit (3) and an associative memory block (2) connected to the input control unit (3). Each word circuit (4) in the associative memory block (2) comprises a first stage sub-word circuit (4a) with k bits which is connected to the search line (1) (SL1) of the input control unit (3) and a second stage sub-word circuit (4b) with n-k bits which is connected to the search line (2) (SL2) of the input control unit (3). The first stage sub-word circuit (4a) with k bits and the second stage sub-word circuit (4b) with n-k bits are divided by a segmentation circuit (5). When the first stage sub-word circuit outputs a match signal, the match result is stored in the segmentation circuit (5), and a plurality of local match circuits in the second stage sub-word circuit (4b) is operated.
  • 出願人(英語)
  • ※2012年7月以前掲載分については米国以外のすべての指定国
  • TOHOKU UNIVERSITY
  • 発明者(英語)
  • HANYU TAKAHIRO
  • MATSUNAGA SHOUN
  • ONIZAWA NAOYA
  • GAUDET VINCENT
国際特許分類(IPC)
指定国 National States: AE AG AL AM AO AT AU AZ BA BB BG BH BN BR BW BY BZ CA CH CL CN CO CR CU CZ DE DK DM DO DZ EC EE EG ES FI GB GD GE GH GM GT HN HR HU ID IL IN IS KE KG KM KN KP KR KZ LA LC LK LR LS LT LU LY MA MD ME MG MK MN MW MX MY MZ NA NG NI NO NZ OM PA PE PG PH PL PT QA RO RS RU RW SC SD SE SG SK SL SM ST SV SY TH TJ TM TN TR TT TZ UA UG US UZ VC VN ZA ZM ZW
ARIPO: BW GH GM KE LR LS MW MZ NA RW SD SL SZ TZ UG ZM ZW
EAPO: AM AZ BY KG KZ RU TJ TM
EPO: AL AT BE BG CH CY CZ DE DK EE ES FI FR GB GR HR HU IE IS IT LT LU LV MC MK MT NL NO PL PT RO RS SE SI SK SM TR
OAPI: BF BJ CF CG CI CM GA GN GQ GW ML MR NE SN TD TG
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