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明細書 :電力素子

発行国 日本国特許庁(JP)
公報種別 特許公報(B2)
特許番号 特許第6712735号 (P6712735)
公開番号 特開2016-157932 (P2016-157932A)
登録日 令和2年6月4日(2020.6.4)
発行日 令和2年6月24日(2020.6.24)
公開日 平成28年9月1日(2016.9.1)
発明の名称または考案の名称 電力素子
国際特許分類 H01L  21/336       (2006.01)
H01L  29/78        (2006.01)
H01L  21/338       (2006.01)
H01L  29/778       (2006.01)
H01L  29/812       (2006.01)
H01L  21/337       (2006.01)
H01L  29/808       (2006.01)
H01L  29/12        (2006.01)
H01L  21/20        (2006.01)
FI H01L 29/78 301H
H01L 29/80 H
H01L 29/80 V
H01L 29/78 301B
H01L 29/78 301V
H01L 29/78 652T
H01L 29/78 653A
H01L 29/78 652E
H01L 29/78 658E
H01L 29/78 658F
H01L 21/20
請求項の数または発明の数 4
全頁数 23
出願番号 特願2016-025819 (P2016-025819)
出願日 平成28年2月15日(2016.2.15)
優先権出願番号 2015035152
優先日 平成27年2月25日(2015.2.25)
優先権主張国 日本国(JP)
審査請求日 平成31年1月24日(2019.1.24)
特許権者または実用新案権者 【識別番号】899000068
【氏名又は名称】学校法人早稲田大学
発明者または考案者 【氏名】小林 幹典
【氏名】稲葉 優文
【氏名】斎藤 俊輝
【氏名】北林 祐哉
【氏名】平岩 篤
【氏名】川原田 洋
個別代理人の代理人 【識別番号】100137800、【弁理士】、【氏名又は名称】吉田 正義
【識別番号】100148253、【弁理士】、【氏名又は名称】今枝 弘充
【識別番号】100148079、【弁理士】、【氏名又は名称】梅村 裕明
【識別番号】100158241、【弁理士】、【氏名又は名称】吉田 安子
審査官 【審査官】岩本 勉
参考文献・文献 特開2014-060377(JP,A)
特開2002-057167(JP,A)
特開平10-125932(JP,A)
特開2013-172023(JP,A)
特開2014-038953(JP,A)
特開平09-172187(JP,A)
特開2006-165013(JP,A)
特開2014-160715(JP,A)
調査した分野 H01L 21/336
H01L 21/20
H01L 21/337
H01L 21/338
H01L 29/12
H01L 29/778
H01L 29/78
H01L 29/808
H01L 29/812
特許請求の範囲 【請求項1】
凹部を有するダイヤモンド基板と、前記凹部の側面に形成された水素化層と、前記水素化層を被覆する保護膜とを備え
前記ダイヤモンド基板は、アンドープダイヤモンド層またはp型ダイヤモンド層からなる第1の層と、前記第1の層の上に積層され、n型ダイヤモンド層からなる第2の層とのダイヤモンドの積層体を備える
ことを特徴とする電力素子。
【請求項2】
前記ダイヤモンド基板と前記保護膜との間に、エピタキシャル成長させて形成したダイヤモンド膜をさらに備え、
前記水素化層は、前記ダイヤモンド膜の表面を水素化することにより形成されたものであることを特徴とする請求項1記載の電力素子。
【請求項3】
前記エピタキシャル成長させて形成したダイヤモンド膜の厚さは、50~1000nmであることを特徴とする請求項2記載の電力素子。
【請求項4】
前記保護膜は、酸化アルミニウム膜で形成されていることを特徴とする請求項1~3のいずれか1項記載の電力素子。
発明の詳細な説明 【技術分野】
【0001】
本発明は、電力素子に関し、特にダイヤモンド半導体を用いた電力素子に関する。
【背景技術】
【0002】
電力素子は、電気機器の電力制御に不可欠であり、この電力素子の損失を低減することによって、エネルギー消費量を大幅に低減することができる。従来のシリコン素子より優れた特性(高耐圧性、低損失性)を備えた電力素子が得られる物質の一つとして、ダイヤモンドが知られている。ダイヤモンドはバンドギャップが大きく、ダイヤモンドを用いることによって、電力素子の小型化・低消費電力化・高効率化が可能である。
【0003】
ダイヤモンド基板の表面を水素化して水素化層を形成することにより、その水素化層の直下に導電層が誘起される。この導電層は、電界効果トランジスタ(FET)動作に必要な高い導電性を有するものであり、将来の高効率電力素子への応用が期待されている。最近では、ダイヤモンド半導体表面の水素化層の上に保護膜を設けることによって、安定して動作する電力素子が提案されている(例えば、特許文献1)。
【先行技術文献】
【0004】

【特許文献1】特開2014-60377号公報
【発明の概要】
【発明が解決しようとする課題】
【0005】
電力素子に対する要求は、よりいっそう厳しいものとなってきている。例えば、電力素子は、耐圧性が高く損失性が低いことに加えて、絶縁耐圧をよりいっそう向上させることが求められている。
【0006】
そこで本発明は、高耐圧、低損失で安定に動作し、絶縁耐圧をよりいっそう向上させることができる電力素子を提供することを目的とする。
【課題を解決するための手段】
【0007】
本発明に係る電力素子は、ダイヤモンド基板と、前記ダイヤモンド基板の厚さ方向に形成された水素化層と、前記水素化層を被覆する保護膜とを備えることを特徴とする。
【発明の効果】
【0008】
本発明によれば、ダイヤモンド基板の厚さ方向に水素化層が形成されており、この水素化層は保護膜により被覆されている。保護膜で被覆されることにより水素化層は保護されているので、高耐圧、低損失で安定に動作する電力素子が得られる。水素化層は、ダイヤモンド基板の厚さ方向に存在していることから、本発明の電力素子においては、導電層(二次元正孔層)もダイヤモンド基板の厚さ方向に存在する。これによって、ゲート-ドレイン電極間距離が長くなるため、絶縁耐圧をよりいっそう向上させた電力素子を提供することができる。
【図面の簡単な説明】
【0009】
【図1】本発明の第1実施形態に係る電力素子の外観図である。
【図2】本発明の第1実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図2Aはダイヤモンド基板を形成した段階、図2Bは金属マスクを形成した段階、図2Cはダイヤモンド基板に凹部を形成した段階を示す図である。
【図3】本発明の第1実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図3Aは金属マスクを除去した段階、図3Bはダイヤモンド膜および水素化層を形成した段階、図3Cは水素化層の所定の領域を酸素終端した段階を示す図である。
【図4】本発明の第1実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図4Aはソース電極、ドレイン電極を形成した段階、図4Bは保護膜を形成した段階を示す図である。
【図5】本発明の第1実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図5Aはソース電極、ドレイン電極の表面の一部を露出させた段階、図5Bはゲート電極が形成された段階を示す図である。
【図6】第1実施形態に係る電力素子の一例の動作特性を示すグラフであり、図6Aはドレイン電流(Ids)のドレイン電圧(Vds)依存性を示し、図6Bはドレイン電流(Ids)のゲート電圧(Vgs)依存性を示す。
【図7】第1実施形態に係る電力素子の他の例の動作特性を示すグラフであり、図7Aはドレイン電流(Ids)のドレイン電圧(Vds)依存性を示し、図7Bはドレイン電流(Ids)のゲート電圧(Vgs)依存性を示す。
【図8】本発明の第2実施形態に係る電力素子の構成を示す縦断面図である。
【図9】本発明の第2実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図9Aはpダイヤモンド層の裏面にドレイン電極を形成した段階、図9Bはpダイヤモンド層の表面にアンドープダイヤモンド層を形成した段階、図9Cは金属マスクを形成した段階を示す図である。
【図10】本発明の第2実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図10Aはダイヤモンド基板に凹部を形成した段階、図10Bは金属マスクを除去した段階、図10Cはダイヤモンド膜および水素化層を形成した段階を示す図である。
【図11】本発明の第2実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図11Aは保護膜を形成した段階、図11Bはフィラーを挿入した段階、図11Cは金属膜を形成した段階を示す図である。
【図12】本発明の第2実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図12Aはゲート電極を埋め込み形成した段階、図12Bは絶縁膜を形成した段階を示す図である。
【図13】本発明の第3実施形態に係る電力素子の構成を示す縦断面図である。
【図14】本発明の第3実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図14Aは金属マスクを形成した段階、図14Bはダイヤモンド基板に凹部を形成した段階、図14Cは金属マスクを除去した段階を示す図である。
【図15】本発明の第3実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図15Aはダイヤモンド膜および水素化層を形成した段階、図15Bは保護膜を形成した段階、図15Cは金属膜を形成した段階を示す図である。
【図16】本発明の第3実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図16Aはゲート電極を埋め込み形成した段階、図16Bは絶縁膜を形成した段階を示す図である。
【図17】本発明の第4実施形態に係る電力素子の構成を示す縦断面図である。
【図18】本発明の第4実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図18Aはpダイヤモンド層の表面にダイヤモンドの積層体を形成した段階、図18Bは金属マスクを形成した段階、図18Cはダイヤモンド基板に凹部を形成した段階を示す図である。
【図19】本発明の第4実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図19Aはダイヤモンド膜および水素化層を形成した段階、図19Bは保護膜を介して金属膜を形成した段階、図19Cは埋め込まれたゲート電極上に絶縁膜を形成した段階を示す図である。
【図20】本発明の第5実施形態に係る電力素子の構成を示す縦断面図である。
【図21】本発明の第5実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図21Aは凹部が形成されたダイヤモンド基板にダイヤモンド膜および水素化層を形成した段階、図21Bは水素化層の所定の領域を酸素終端した段階、図21Cはソース電極を形成した段階を示す図である。
【図22】本発明の第5実施形態に係る電力素子の製造方法を段階的に示す縦断面図であり、図22Aは絶縁膜を形成した段階、図22Bはソース電極の表面の一部を露出させた段階を示す図である。
【図23】第5実施形態に係る電力素子の一例の動作特性を示すグラフであり、図23Aはドレイン電流(Ids)のドレイン電圧(Vds)依存性を示し、図23Bはブレークダウン電圧を示す。
【発明を実施するための形態】
【0010】
以下、図面を参照して本発明の実施形態について詳細に説明する。

【0011】
1.第1実施形態
(全体構成)
本発明の第1実施形態に係る電力素子30の全体構成について、図1を参照して説明する。

【0012】
本実施形態に係る電力素子30は、窒素を高濃度で含み半絶縁性のnダイヤモンド層(以下、単にn層とも称する)2上にアンドープダイヤモンド層4が形成されたダイヤモンド基板6を備えている。なお、窒素を高濃度で含むダイヤモンドは、Ib型と称されている。アンドープダイヤモンド層4は、マイクロ波励起プラズマを用いた化学気相堆積法(plasma-enhanced chemical vapor deposition:PECVD)により、n層2上にエピタキシャル成長させて形成されている。

【0013】
ダイヤモンド基板6は表面に凹部10を有し、この凹部10の側面の一部には保護膜24を介してゲート電極26aが形成されている。ダイヤモンド基板6の表面の所定の領域には、側面にゲート電極26aが形成された凹部10を挟んで、ソース電極22aおよびドレイン電極22bが形成されている。保護膜24は、ゲート電極26aの下層でゲート絶縁膜として作用する。また、保護膜24は、ソース電極22a、ドレイン電極22bの表面の一部を残して、ダイヤモンド基板6の表面を覆っている。

【0014】
ゲート電極26aは、例えばアルミニウム(Al)を蒸着することにより形成することができる。ソース電極22a、ドレイン電極22bは、例えばチタン(Ti)膜と金(Au)膜とを順次蒸着した積層膜により形成することができる。

【0015】
保護膜24は、酸化アルミニウム(Al)で形成されている。なお、保護膜24の組成は、必ずしもAl:O=2:3となっている訳でないが、本明細書においては、簡略化のために同保護膜をAlと記す。

【0016】
本実施形態の電力素子30においては、保護膜24は、ダイヤモンド基板6上の水素化層(図示せず)を被覆して保護するものである。ソース電極22a、ドレイン電極22b以外の領域においては、凹部10の側面および底面を含めて、C-H結合を有する水素化層が保護膜24の下層に存在している。水素化層においては、ダイヤモンド結晶の表面が水素化されている。具体的には、ダイヤモンド結晶の表面の炭素原子のダングリングボンド、すなわち余った結合手(未結合手)に水素原子が結合している。水素化層の直下には、図示しない二次元正孔層が存在する。二次元正孔層は、高い導電性を有し、電界効果トランジスタのドリフト層として用いられる。こうした水素化層および二次元正孔層については、追って詳細に説明する。

【0017】
(製造方法)
次に、本実施形態に係る電力素子30の製造方法を説明する。

【0018】
まず、窒素を高濃度に含み半絶縁性のダイヤモンド層(n層)2を、順次アンモニア・過酸化水素混合水溶液および塩酸・過酸化水素混合水溶液を用いて洗浄する。これらは、半導体装置の製造において通常行われる方法である。さらに、80℃以上に加熱した硝酸・硫酸混合水溶液を用いて洗浄する。これにより、表面に残留している金属不純物、有機物およびグラファイト状の表面層を除去もしくは低減する。

【0019】
洗浄後のn層2の表面には、プラズマCVD法により、厚さ3~10μm程度の厚さのアンドープダイヤモンド層4をエピタキシャル成長させる。合成ガスとしては、水素(Hガス)と炭素源としてのメタン(CH)ガスとが用いられる。こうして、図2Aに示すようなn層2上にアンドープダイヤモンド層4が積層されたダイヤモンド基板6を得る。

【0020】
ダイヤモンド基板6上には、図2Bに示すような金属マスク8を、Auを用いてリフトオフ技術により形成する。具体的には、所定の領域に厚膜のレジストマスクを形成し、全面にスパッタリング法によりAu膜を形成する。厚膜レジストマスクをアセトン等の有機溶媒を用いて除去すると、厚膜レジストマスク上のAu膜もリフトオフにより除去されて金属マスク8が得られる。

【0021】
さらに、Oプラズマを用いた誘導結合型反応性イオンエッチング(Inductively Coupled Plasma Reactive Ion Etching:ICP-RIE)によりダイヤモンド基板6の表面を加工して図2Cに示すように凹部10を形成する。その後、金エッチング液(関東化学(株):AURUMシリーズ)を用いて図3Aに示すように金属マスク8を除去する。ダイヤモンド基板6に形成される凹部10の寸法は、適宜設定することができる。例えば、凹部10の深さdは、0.1~10μm程度、好ましくは1.2~2.4μm程度とすることができる。凹部10の幅wは、1~50μm程度、好ましくは5~20μm程度とすることができる。凹部10のアスペクト比(d/w)は、少なくとも0.1以上であることが好ましい。これは、基板上における少ない面積でチャネル長を十分に確保して、絶縁耐圧の向上を図るためである。凹部10の底面とn層2の表面との距離dは、特に限定されない。場合によっては、凹部10がn層2に達していてもよい。

【0022】
凹部10が形成されたダイヤモンド基板6の全面には、図3Bに示すようにプラズマCVD法によりダイヤモンド膜14をエピタキシャル成長させた後、ダイヤモンド膜14の表面に水素化層16を形成する。ダイヤモンド膜14の厚さは、50~1000nm程度とすることが好ましい。また、ダイヤモンド膜14においては、窒素濃度をボロン濃度より低くすることが望ましい。ダイヤモンド膜14における窒素濃度がボロン濃度より低いことは、後程で行う水素化処理により水素化層16を形成し、その直下に二次正孔層を誘起するのに有利となる。水素化層16は、400~700℃(ここでは600℃)に加熱しながら水素プラズマを照射することによって、ダイヤモンド膜14の表面に形成される。なお、ダイヤモンド基板6上にエピタキシャル成長させたダイヤモンド膜14は、透過型電子顕微鏡(Transmission Electron Microscope:TEM)観察により確認することができる。

【0023】
水素化層16の直下には、C-H結合と表面に吸着した大気中の不純物とによって、図示しない二次元正孔層が誘起される。二次元正孔層は、2次元正孔ガス(two dimensional hole gas:2DHG)とも称される。二次元正孔層は、正孔が二次元状に分布してなる導電層であり、一般的には5~20nmの厚さを有する。このように形成される二次元正孔層は、高い導電性を有し、電界効果トランジスタのドリフト層として用いられる。

【0024】
次いで、少なくとも凹部10の側面および底面に形成された水素化層16を覆って、図3Cに示すようにホトレジストマスク12をホトリソグラフィー法により形成する。このように水素化層16の所定の領域をホトレジストマスク12で保護し、水素化層16の露出部を酸素プラズマ装置(ここでは酸素プラズマアッシャー)により酸素終端して、酸素終端領域18に変化させる。

【0025】
その後、図4Aに示すようなAu/Ti積層膜からなるソース電極22a、ドレイン電極22bを、50~200nm程度の厚さでリフトオフ技術により形成する。ソース電極22a、ドレイン電極22bは、例えば所定の領域にホトレジストマスクを形成し、Ti膜、Au膜を蒸着法により全面に順次堆積してAu/Ti積層膜を得た後、ホトレジストマスクを除去して、所定領域以外のAu/Ti積層膜のみを残すことにより形成することができる。酸素終端領域18であったソース電極22a、ドレイン電極22bの下の領域には、450~500℃での加熱によって3nm程度の厚さのTiC膜20が形成される。このTiC膜20は、ソース/ドレイン領域として作用する。図示するように、酸素終端領域18、TiC膜20上に形成されたソース電極22a、ドレイン電極22b以外の領域には、凹部10の側面および底面を含めて水素化層16が露出している。

【0026】
次いで、図4Bに示すように、保護膜24としてのAl膜を10~400nmの厚さで全面に形成する。保護膜24は、200℃以上の高温で原子層堆積(Atomic Layer Deposition:ALD)法により形成することができる。具体的には、大気の混入を低減した状態、例えばロードロック装置を用い減圧した非酸化性雰囲気(ここでは窒素)中で、試料を反応室へ導入し、反応気体としてAl源と酸化剤とを用いた450℃の熱処理によって、Al膜が全面に堆積される。Al源としてはトリメチルアルミニウム(TMA)が用いられ、酸化剤としてはC-H結合と吸熱反応をする反応種(ここではHO)が用いられる。熱処理時間は、適宜選択することができ、例えば20分~20時間である。

【0027】
図4Bに示すように、ダイヤモンド基板6の表面のみならず、凹部10の側面および底面においても、水素化層16は、保護膜24に覆われて保護される。保護膜24は、追って形成されるゲート電極の下層でゲート絶縁膜として作用する。

【0028】
その後、ホトレジスト技術、エッチング技術により表面の保護膜をエッチングして、図5Aに示すように、ソース電極22a、ドレイン電極22bの表面の一部を露出する。最後に、図5Bに示すように、保護膜24の所定の領域にAl膜を用いてゲート電極26aを50nm程度の厚さで形成する。ゲート電極26aは、ゲート部以外の領域にレジストマスクを形成した後、Alを全面に蒸着してAl膜を得、ホトレジストマスクを除去して形成することができる。

【0029】
以上の工程により、図5Bに示すような第1実施形態の電力素子30が得られる。電力素子30は、水素化層16直下に誘起された二次元正孔層をチャネル層としたMISFET(Metal-Insulator-Semiconductor Field Effect Transistor)である。この電力素子30においては、ダイヤモンド膜14を覆うゲート長Lは、例えば1~20μm程度とすることができる。また、電極間距離LS-Dは、例えば10~50μm程度とすることができる。上述したとおり、凹部10の深さdは、例えば0.1~10μm程度とすることができる。

【0030】
(作用および効果)
本実施形態に係る電力素子30は、凹部10を有するダイヤモンド基板6を備え、凹部10の側面および底面には保護膜24が形成されている。この保護膜24は、ダイヤモンド基板6の凹部10の側面および底面において、水素化層16を被覆して保護するものである。凹部10の側面および底面で保護膜24に保護されている水素化層16の直下には、二次元正孔層が誘起されている。本実施形態に係る電力素子30においては、二次元正孔層は、ダイヤモンド基板6の主面に平行に存在し、さらに、ダイヤモンド基板6の厚さ方向にも存在することとなる。このため、ダイヤモンド基板6の厚さ方向の領域も伝導に寄与することができる。

【0031】
これによって、本実施形態に係る電力素子30においては、ゲート-ドレイン電極間距離LG-Dが長くなるため、基板の単位面積当たりでの絶縁耐圧を向上させることが可能である。

【0032】
また、水素化層16は、凹部10を有するダイヤモンド基板6上にエピタキシャル成長させたダイヤモンド膜14の表面に形成されている。ダイヤモンド基板6の表面は、このダイヤモンド基板6に凹部10を形成する際のエッチングによりダメージを受けて、酸素終端されている場合が多い。こうしたダイヤモンド基板6の表面にダイヤモンド膜14が存在することによって、ダイヤモンド基板6の表面の影響を受けることなく安定した水素化層16を確実に形成することができる。しかも、水素化層16の直下に誘起される二次元正孔層の安定性も高い。

【0033】
本実施形態においては、ALD法により形成されたAl膜が保護膜24として用いられている。ALD法によって形成されるAl膜からなる保護膜24は、ステップカバレッジに優れているので、ダイヤモンド基板6の凹部10の側面の水素化層16を確実に被覆して、保護することができる。しかも、Al膜からなる保護膜は、非酸化性雰囲気中で形成されるので、水素化層16が大気中の酸素の影響を受けることはない。水素化層16の一部が消失することはなく、この水素化層16の直下に誘起された二次元正孔層の導電性が低下することも避けられる。

【0034】
したがって、本実施形態に係る電力素子30は、高温での加熱後、もしくは高温環境下においても、良好な動作特性を有することができる。

【0035】
なお、本実施形態に係る電力素子30においては、ソース電極22a、ドレイン電極22bの下層にはTiC膜20が形成されている。ここでのTiC膜20は、二次元正孔層より極めて抵抗の低い、極浅のソース/ドレイン領域である。このような極浅の接合は、デバイスの微細化に伴うショートチャネル効果に対する耐性が強く、これによっても電力素子30の特性が高められる。

【0036】
ここで、第1実施形態に係る電力素子30の一例の動作特性を図6に示す。図5Bにおける電極間距離LS-Dは40μmとし、ゲート長Lは20μmとし、凹部10の深さdは1.2μmとした。図6Aには、-10Vから+10Vの間での2V毎のゲート電圧(Vgs)におけるドレイン電流(Ids)のドレイン電圧(Vds)依存性を示す。図6Bには、ドレイン電圧(Vds)=-10Vにおけるドレイン電流(Ids)のゲート電圧(Vgs)依存性を示す。図6A,図6Bには、典型的なソースードレイン間の電圧に対する電流の特性が示されており、電力素子に電流が流れてスイッチとして機能することが表れている。

【0037】
また、凹部10の深さdを2.4μmとした以外は、前述と同様の電力素子の動作特性を図7に示す。図7Aには、-10Vから+10Vの間での2V毎のゲート電圧(Vgs)におけるドレイン電流(Ids)のドレイン電圧(Vds)依存性を示す。図7Bには、ドレイン電圧(Vds)=-10Vにおけるドレイン電流(Ids)のゲート電圧(Vgs)依存性を示す。図7A,図7Bにも、典型的なソースードレイン間の電圧に対する電流の特性が示されており、電力素子に電流が流れてスイッチとして機能することが表れている。

【0038】
上記のように構成された電力素子は、電気機器の電力制御に不可欠なパワーデバイスに適用でき、ハイブリッド自動車などのモータ駆動やエアコンの制御機器に適用することができる。

【0039】
2.第2実施形態
(全体構成)
次に、本発明の第2実施形態に係る電力素子40の全体構成について、第1実施形態に係る電力素子30と同様の構成について同様の符号を付した図8を参照して説明する。

【0040】
本実施形態に係る電力素子40は、ボロンを含有するpダイヤモンド層(以下、単にp層とも称する)32上にアンドープダイヤモンド層4が形成されたダイヤモンド基板34と、ダイヤモンド基板34の表面に形成されたAu/Ti積層膜からなるソース電極22aと、ダイヤモンド基板34の裏面に形成されたAu/Ti積層膜からなるドレイン電極22bとを備えている。

【0041】
ダイヤモンド基板34は凹部10を有し、この凹部10内には、シリコン酸化物からなる絶縁性のフィラー36上に配置されたゲート電極26aが、Alからなる保護膜24を介して埋め込まれている。フィラー36とp層32との間には保護膜24が形成され、ゲート電極26aは絶縁膜38によってソース電極22aから絶縁されている。

【0042】
保護膜24は、ダイヤモンド基板34の凹部10の側面および表面の一部において、水素化層16を被覆して保護している。ダイヤモンド基板34におけるアンドープダイヤモンド層4と水素化層16との間には、エピタキシャル成長させて形成されたダイヤモンド膜14が存在する。第1実施形態に係る電力素子30と同様、第2実施形態に係る電力素子40においても、水素化されたダイヤモンド膜14の表面が、水素化層16に相当する。

【0043】
(製造方法)
次に本実施形態に係る電力素子40の製造方法を説明する。

【0044】
まず、図9Aに示すように、ボロンを含有するダイヤモンド層(p層)32の裏面にドレイン電極22bを500nm程度の厚さで形成する。ドレイン電極22bは、蒸着法によりTi膜、Au膜を順次積層したAu/Ti積層膜により構成することができる。

【0045】
裏面にドレイン電極22bを有するp層32の表面には、第1実施形態の場合と同様の手法により、図9Bに示すように、3~10μm程度の厚さのアンドープダイヤモンド層4を形成する。p層32とアンドープダイヤモンド層4とによって、本実施形態に係る電力素子40におけるダイヤモンド基板34が構成される。

【0046】
ダイヤモンド基板34の表面には、第1実施形態の場合と同様の手法により、Auを用いて図9Cに示すような金属マスク8を形成する。

【0047】
さらに、ICP-RIEによりダイヤモンド基板34の表面を加工して図10Aに示すように凹部10を形成した後、第1実施形態と同様の金エッチング液を用いて図10Bに示すように金属マスク8を除去する。本実施形態においては、凹部10の底面にはp層32が露出している。凹部10の幅wは適宜選択することができ、例えば1~50μm程度、好ましくは2~10μm程度とすることができる。凹部10のアスペクト比(d/w)は、少なくとも1以上であることが好ましい。

【0048】
次いで、第1実施形態の場合と同様の手法により、エピタキシャル成長によりダイヤモンド膜14を成長させ、ダイヤモンド膜14の表面に水素化層16を形成する。第2実施形態においては、ダイヤモンド膜14および水素化層16は、図10Cに示すように、凹部10の底面のp層32上には形成されず、アンドープダイヤモンド層4の表面および側面に形成される。水素化層16の直下には、第1実施形態の場合と同様、図示しない二次正孔層が5~20nmの厚さで誘起される。

【0049】
その後、図11Aに示すように、保護膜24としてのAl膜を、凹部10の側面および底面を含む全面に形成し、これにより水素化層16を被覆して保護する。保護膜24は、第1実施形態と同様の手法により、同様の厚さで形成することができる。

【0050】
保護膜24により側面および底面が覆われた凹部10内には、絶縁材料としてのシリコン酸化物をスピンコート法、TEOS-CVD法などにより堆積して、図11Bに示すようにフィラー36を形成する。十分な絶縁耐圧を確保するため、フィラー36の表面とp層34との距離dは、少なくとも3μm程度であることが好ましい。

【0051】
フィラー36が形成された凹部10内、および凹部10外の保護膜24の上には、図11Cに示すように、金属膜26としてのAl膜を形成する。CMP(Chemical Mechanical Polishing)を行って凹部10外の金属膜26を保護膜24とともに除去して、図12Aに示すように水素化層16を露出させる。凹部10内に保護膜24を介して残置された金属膜26が、ゲート電極26aとなる。ゲート電極26aに接している保護膜24は、ゲート絶縁膜として作用する。

【0052】
次いで、図12Bに示すように、ゲート電極26a上に絶縁膜38を形成する。ここでの絶縁膜38は、例えば20V程度の電圧に耐えることが要求され、例えば10~200nm程度の厚さとすることができる。こうした絶縁膜38は、必ずしもALD法により形成されたAl膜である必要はなく、SiO等を絶縁材料として用いることができる。絶縁膜38は、水素化層16の上に選択的にホトレジストマスクを形成し、全面に絶縁材料を堆積した後、ホトレジストマスクを除去して形成することができる。水素化層16および絶縁膜38の全面には、Ti膜、Au膜を蒸着法により順次堆積して、Au/Ti積層膜からなるソース電極22aを500nm程度の厚さで形成する。

【0053】
以上の工程により、図8に示したような第2実施形態の電力素子40が得られる。

【0054】
(作用および効果)
本実施形態に係る電力素子40は、凹部10を有するダイヤモンド基板34を備え、凹部10の側面では、第1実施形態と同様、保護膜24が水素化層16を被覆して保護している。水素化層16の直下には、ダイヤモンド基板34の厚さ方向に二次元正孔層が誘起されていることから、本実施形態に係る電力素子40においても、上記第1実施形態と同様の効果を得ることができる。

【0055】
また、本実施形態に係る電力素子40においては、ゲート電極26aがダイヤモンド基板34内に埋め込まれていることから、単位セル面積を縮小することができる。これによって、オン抵抗を低減することが可能である。

【0056】
さらに、第2実施形態に係る電力素子40では、ゲート電極26aの下層に絶縁材料(シリコン酸化物)からなるフィラー36が配置されている。この絶縁材料の熱伝導率が高いことから、効率的に放熱できるといった効果も得られる。

【0057】
3.第3実施形態
(全体構成)
次に、本発明の第3実施形態に係る電力素子50の全体構成について、第2実施形態に係る電力素子40と同様の構成について同様の符号を付した図13を参照して説明する。

【0058】
本実施形態に係る電力素子50は、ボロンを含有するpダイヤモンド層(以下、単にp層とも称する)32上にアンドープダイヤモンド層4が形成されたダイヤモンド基板34と、ダイヤモンド基板34の表面に形成されたAu/Ti積層膜からなるソース電極22aと、ダイヤモンド基板34の裏面に形成されたAu/Ti積層膜からなるドレイン電極22bとを備えている。

【0059】
ダイヤモンド基板34は凹部10を有し、この凹部10内には、Alからなる保護膜24を介してゲート電極26aが埋め込まれている。ゲート電極26aは絶縁膜38によりソース電極22aから絶縁されている。

【0060】
保護膜24は、ダイヤモンド基板34における凹部10の側面および底面を被覆して、水素化層16を保護している。水素化層16とダイヤモンド基板34との間には、エピタキシャル成長させて形成されたダイヤモンド膜14が存在する。第1実施形態、第2実施形態と同様、水素化されたダイヤモンド膜14の表面が、水素化層16に相当する。

【0061】
第3実施形態に係る電力素子50は、ダイヤモンド基板34に設けられた凹部10がp層32に達しておらず、ゲート電極26aの下にフィラー36が配置されていない点が、第2実施形態に係る電力素子40とは異なっており、これ以外は、第2実施形態に係る電力素子40と同様である。

【0062】
(製造方法)
次に、本実施形態に係る電力素子50の製造方法を説明する。

【0063】
まず、第2実施形態と同様にして、裏面にドレイン電極22bが形成されたダイヤモンド基板34の表面に、図14Aに示すように金属マスク8を形成する。

【0064】
次いで、ICP-RIEによりダイヤモンド基板34の表面を加工して図14Bに示すように凹部10を形成した後、第1実施形態と同様の金エッチング液を用いて図14Cに示すように金属マスク8を除去する。

【0065】
本実施形態においては、凹部10の深さdは、0.1~50μm程度、好ましくは10~30μm程度とすることができる。凹部10の幅wは適宜選択することができ、例えば1~50μm程度、好ましくは2~10μm程度とすることができる。凹部10のアスペクト比(d/w)は、少なくとも0.1以上であることが好ましい。これは、凹部10底面からでなくダイヤモンド基板34上面からp層32に直接伝導する伝導パスを抑制し、高いオン/オフ制御性を確保するためである。さらに、絶縁耐圧を向上させるために、凹部10の底面とp層32との距離dは、少なくとも1μm程度であることが好ましい。因みに、凹部10の底面とp層32との距離dを3μm以上として製造された電力素子は、3000Vの電圧に耐えることができる。

【0066】
次いで、第1実施形態の場合と同様の手法により、凹部10が形成されたダイヤモンド基板34の全面に、図15Aに示すようにダイヤモンド膜14および水素化層16を形成する。第1実施形態、第2実施形態の場合と同様、第3実施形態においても、水素化層16の直下には、図示しない二次正孔層が5~20nmの厚さで誘起される。水素化層16の上には、図15Bに示すように保護膜24としてのAl膜を形成し、これにより水素化層16を被覆して保護する。保護膜24は、第1実施形態と同様の手法により、同様の厚さで全面に形成することができる。

【0067】
保護膜24が形成された凹部10内、および凹部10外の保護膜24の上には、図15Cに示すように、金属膜26としてのAl膜を形成する。CMPを行って凹部10外の金属膜26を保護膜24とともに除去して、図16Aに示すように水素化層16を露出させる。凹部10内に残置された金属膜26が、ゲート電極26aとなる。ゲート電極26aに接している保護膜24は、ゲート絶縁膜として作用する。

【0068】
次いで、図16Bに示すように、ゲート電極26a上に絶縁膜38を形成する。絶縁膜38は、第2実施形態の場合と同様の材料を用いて、同様の手法により形成することができる。その後、水素化層16および絶縁膜38の全面に、Ti膜、Au膜を蒸着法により順次堆積して、Au/Ti積層膜からなるソース電極22aを500nm程度の厚さで形成する。

【0069】
以上の工程により、図13に示した第3実施形態の電力素子50が得られる。

【0070】
(作用および効果)
本実施形態に係る電力素子50は、凹部10を有するダイヤモンド基板34を備え、凹部10の側面では、第1実施形態と同様、保護膜24が水素化層16を被覆して保護している。水素化層16の直下には、ダイヤモンド基板34の厚さ方向に二次元正孔層が誘起されていることから、本実施形態に係る電力素子50においても、上記第1実施形態と同様の効果を得ることができる。

【0071】
また、本実施形態に係る電力素子50においては、ゲート電極26aがダイヤモンド基板34内に埋め込まれていることから、単位セル面積をよりいっそう縮小することができ、第2実施形態と同様の効果も得られる。

【0072】
さらに、本実施形態に係る電力素子50は、アンドープダイヤモンド層4の領域でキャリアはバルク伝導するため、キャリアは結晶中で電界集中を起こしにくく絶縁耐圧の向上が図りやすい。

【0073】
4.第4実施形態
(全体構成)
次に、本発明の第4実施形態に係る電力素子60の全体構成について、第3実施形態に係る電力素子50と同様の構成について同様の符号を付した図17を参照して説明する。

【0074】
本実施形態に係る電力素子60は、ボロンを含有するpダイヤモンド層(以下、単にp層とも称する)32上に、ダイヤモンドの積層体46が設けられたダイヤモンド基板44を備える。ダイヤモンド基板44の表面には、Au/Ti積層膜からなるソース電極22aが形成され、ダイヤモンド基板44の裏面には、Au/Ti積層膜からなるドレイン電極22bが形成されている。

【0075】
本実施形態においては、ダイヤモンドの積層体46は、アンドープダイヤモンド層からなる第1の層47と、第1の層47上に積層されたn型ダイヤモンド層(以下、単にn層とも称する)からなる第2の層48とから構成される。第2の層48としてのn層は、n型不純物、例えば窒素を含む半絶縁性のダイヤモンド層である。

【0076】
ダイヤモンドの積層体46における第1の層47と第2の層48との境界は、凹部10の底面より上方に設けられているが、凹部10の底面と同等の高さでもよい。

【0077】
ダイヤモンド基板44は凹部10を有し、この凹部10内には、Alからなる保護膜24を介してゲート電極26aが埋め込まれている。ゲート電極26aは絶縁膜38によりソース電極22aから絶縁されている。

【0078】
保護膜24は、ダイヤモンド基板44における凹部10の側面および底面を被覆して、水素化層16を保護している。水素化層16とダイヤモンド基板44との間には、エピタキシャル成長させて形成されたダイヤモンド膜14が存在する。前述の実施形態と同様、水素化されたダイヤモンド膜14の表面が、水素化層16に相当する。

【0079】
第4実施形態に係る電力素子60は、ダイヤモンド基板44が、アンドープダイヤモンド層からなる第1の層47と、第1の層47の上に積層されたn層からなる第2の層48とのダイヤモンドの積層体46を含む点が、第3実施形態に係る電力素子50とは異なっており、これ以外は、第3実施形態に係る電力素子50と同様である。

【0080】
(製造方法)
次に、本実施形態に係る電力素子60の製造方法を説明する。

【0081】
図18Aに示すように、Au/Ti積層膜からなるドレイン電極22bを裏面に有するp+層32の表面に、アンドープダイヤモンド層からなる第1の層47とn層からなる第2の層48とを含むダイヤモンドの積層体46を3~10μm程度の厚さで形成して、ダイヤモンド基板44を得る。アンドープダイヤモンド層は、第1実施形態の場合と同様の方法で形成することができる。n層を形成するには、n型不純物源をさらに用いる。

【0082】
ダイヤモンド基板44上には、図18Bに示すような金属マスク8を、第1実施形態の場合と同様にAuを用いてリフトオフ技術により形成する。ICP-RIEによりダイヤモンド基板44の表面を加工して図18Cに示すように凹部10を形成した後、第1実施形態と同様の金エッチング液を用いて金属マスク8を除去する。

【0083】
凹部10が形成されたダイヤモンド基板44の全面に、第1実施形態の場合と同様の手法により、図19Aに示すようにダイヤモンド膜14および水素化層16を形成する。前述の実施形態の場合と同様、水素化層16の直下には、図示しない二次正孔層が5~20nmの厚さで誘起される。水素化層16の上には、図19Bに示すように、保護膜24を介して金属膜26を形成する。保護膜24および金属膜26は、第3実施形態の場合と同様に形成することができる。

【0084】
CMPにより凹部10外の金属膜26を保護膜24とともに除去し、残置された金属膜26からなるゲート電極26a上に、図19Cに示すように絶縁膜38を形成する。絶縁膜38は、第3実施形態の場合と同様の材料を用いて、同様の手法により形成することができる。その後、第3実施形態の場合と同様にしてソース電極22aを形成する。

【0085】
以上の工程により、図17に示した第4実施形態の電力素子60が得られる。

【0086】
(作用および効果)
本実施形態に係る電力素子60は、凹部10を有するダイヤモンド基板44を備え、凹部10の側面では、第1実施形態と同様、保護膜24が水素化層16を被覆して保護している。水素化層16の直下には、ダイヤモンド基板34の厚さ方向に二次元正孔層が誘起されていることから、本実施形態に係る電力素子60においても、上記第1実施形態と同様の効果を得ることができる。

【0087】
また、本実施形態に係る電力素子60においては、ゲート電極26aがダイヤモンド基板44内に埋め込まれていることから、単位セル面積をよりいっそう縮小することができ、第2実施形態、第3実施形態と同様の効果も得られる。

【0088】
さらに、本実施形態に係る電力素子60は、ダイヤモンド基板44が、アンドープダイヤモンド層からなる第1の層47と、n層からなる第2の層48とのダイヤモンドの積層体46を備えているため、リーク電流をより確実に抑えることができる。

【0089】
5.第5実施形態
(全体構成)
次に、本発明の第5実施形態に係る電力素子70の全体構成について、第4実施形態に係る電力素子60と同様の構成について同様の符号を付した図20を参照して説明する。

【0090】
本実施形態に係る電力素子70は、ボロンを含有するpダイヤモンド層(以下、単にp層とも称する)32上に、ダイヤモンドの積層体46が設けられたダイヤモンド基板44を備える。ダイヤモンド基板44の裏面には、Au/Ti積層膜からなるドレイン電極22bが形成されている。

【0091】
ダイヤモンドの積層体46は、第4実施形態の場合と同様にアンドープダイヤモンド層からなる第1の層47と、第1の層47上に積層されたn型ダイヤモンド層(以下、単にn層とも称する)からなる第2の層48とから構成される。

【0092】
ダイヤモンド基板44は表面に凹部10を有し、この凹部10の表面には、Al23からなる保護膜24を介してゲート電極26aが形成されている。保護膜24は、ダイヤモンド基板44における凹部10の側面および底面を被覆して、水素化層16を保護している。水素化層16とダイヤモンド基板44との間には、エピタキシャル成長させて形成されたダイヤモンド膜14が存在する。

【0093】
ゲート電極26aが形成された凹部10を挟むダイヤモンド基板44の表面には、TiC層20を介して2つのソース電極22aが形成されている。ソース電極22aは、表面の一部を残して保護膜24で覆われている。

【0094】
(製造方法)
次に、本実施形態に係る電力素子70の製造方法を説明する。

【0095】
図21Aに示すように、裏面にドレイン電極22bを有し、表面の所定の領域に凹部10が形成されたダイヤモンド基板44の全面に、第4実施形態の場合と同様の手法によりダイヤモンド膜14および水素化層16を形成する。前述の実施形態の場合と同様、水素化層16の直下には、図示しない二次正孔層が5~20nmの厚さで誘起される。

【0096】
次いで、第1の実施形態の場合と同様の手法により、少なくとも凹部10の側面および底面に形成された水素化層16を覆って図21Bに示すようなホトレジストマスク12を形成し、水素化層16の露出部を酸素終端領域18に変化させる。

【0097】
酸素終端領域18上には、第1の実施形態の場合と同様の手法により、Au/Ti積層膜からなるソース電極22aを形成する。図21Cに示すように、ソース電極22aの直下の酸素終端領域18は、加熱によってTiC膜20となる。酸素終端領域18、TiC膜20上に形成されたソース電極22a以外の領域には、凹部10の側面および底面を含めて水素化層16が露出している。

【0098】
水素化層16を含む全面には、図22Aに示すように保護膜24としてのAl膜を形成する。保護膜24は、第1実施形態と同様の手法により、同程度の厚さで形成することができる。図22Aに示すように、水素化層16は、ダイヤモンド基板44の表面に加え、凹部10の側面および底面においても保護膜24に覆われて保護される。保護膜24は、追って形成されるゲート電極の下層でゲート絶縁膜として作用する。

【0099】
その後、第1実施形態と同様の手法により保護膜24の一部をエッチングして、図22Bに示すようにソース電極22aの表面の一部を露出する。最後に、保護膜24の所定の領域に、第1実施形態の場合と同様の手法によりゲート電極26aを形成して、図20に示した本実施形態の電力素子70が得られる。

【0100】
(作用および効果)
本実施形態に係る電力素子70は、凹部10を有するダイヤモンド基板44を備え、凹部10の側面では、第1実施形態と同様、保護膜24が水素化層16を被覆して保護している。水素化層16の直下には、ダイヤモンド基板34の厚さ方向に二次元正孔層が誘起されていることから、本実施形態に係る電力素子70においても、上記第1実施形態と同様の効果を得ることができる。

【0101】
また、本実施形態に係る電力素子70においては、ゲート電極26aがダイヤモンド基板44内に埋め込まれていることから、単位セル面積をよりいっそう縮小することができ、第2実施形態、第3実施形態、第4実施形態と同様の効果も得られる。

【0102】
さらに、本実施形態に係る電力素子70は、ダイヤモンド基板44が、アンドープダイヤモンド層からなる第1の層47とn層からなる第2の層48とのダイヤモンドの積層体46を備えているため、第4実施形態と同様にリーク電流をより確実に抑えることができる。

【0103】
ここで、第5実施形態に係る電力素子70の一例の動作特性を図23A、図23Bに示す。図20における電極間距離L11は40μmとし、ダイヤモンド基板44の表面におけるゲート電極26aの端部間の距離L12は20μmとした。凹部10側面における水素化層16の距離W11は10μmとし、凹部10の深さd11は2.5μmとした。第1の層47の厚さt11は1μmとし、第2の層48の厚さt12は2μmとした。ダイヤモンド膜14の厚さは100nmとした。

【0104】
図23Aには、-20Vから+40Vの間のゲート電圧(Vgs)におけるドレイン電流(Ids)のドレイン電圧(Vds)依存性を示す。図23Aには、典型的なソースードレイン間の電圧に対する電流の特性が示されている。第5実施形態に係る電力素子70は、ブレークダウン電圧が634V(図23B)であり、高い耐圧性を有している。図23A,図23Bから、本実施形態の電力素子70に電流が流れてスイッチとして機能することが表れている。

【0105】
6.変形例
本発明は上記実施形態に限定されるものではなく、本発明の趣旨の範囲内で適宜変更することが可能である。例えば、上記実施形態では、エッチングによりダイヤモンド基板に凹部を形成する際の金属マスクとしてAu膜を用いたが、ダイヤモンド基板をエッチングから保護できる任意の金属、例えば、Al膜を金属マスクとして用いることもできる。また、凹部を形成するためにダイヤモンド基板のエッチングの際に用いるガスには、八フッ化プロパン(C)ガス等のクリーニングガスが含有されていてもよい。

【0106】
上記実施形態においては、水素化層は、凹部が形成されたダイヤモンド基板上にダイヤモンド膜をエピタキシャル成長させ、このダイヤモンド膜の表面に水素プラズマを照射することにより形成したが、水素プラズマ照射は必ずしも必要ではない。水素プラズマ照射を敢えて行わなくとも、ダイヤモンド膜の表面は十分な水素化がなされている場合も多い。これは、ダイヤモンド膜のエピタキシャル成長工程自体に水素化の作用が有るためであり、水素プラズマ照射を割愛することも可能である。この場合、ダイヤモンド膜のエピタキシャル成長自体が水素化処理工程を兼ねている。

【0107】
凹部が形成されたダイヤモンド基板上にダイヤモンド膜をエピタキシャル成長させることなく、凹部が形成されたダイヤモンド基板の表面を水素終端することによって、ダイヤモンド基板の表面に水素化層を形成してもよい。この場合、水素化層は、凹部が形成されたダイヤモンド基板に水素プラズマを照射することによって、ダイヤモンド基板の表面に形成することができる。これにより、ダイヤモンド膜のエピタキシャル成長工程を省くことも可能となる。

【0108】
また、上記実施形態においては、水素化層を被覆して保護する保護膜としてのAl膜を形成する際、非酸化性の雰囲気として窒素を用いたが、Ar等の不活性気体、あるいは、窒素と不活性気体との混合気体を用いてもよい。Al膜を形成するために酸化剤としてはHOを用いたが、C-H結合と吸熱反応をする任意の反応種を酸化剤として用いることができる。例えば、メタノール(CHO)、エタノール(CO)、プロパノール(CO)、ブタノール(C10O)等のアルコールを酸化剤として用いてもよい。

【0109】
なお、水素化層の直下に誘起された二次元正孔層を確実に維持するために、保護膜は、高温加熱後もしくは高温動作時においても水素化層を保護できることが要求される。このような保護膜をステップカバレッジよく形成できれば、成膜方法はALD法に限定されない。例えば、CVD法により形成することとしてもよい。適切な保護膜が形成されれば、窒化アルミニウム(AlN)を用いることもできる。

【0110】
さらに、各種材料の変更も可能である。例えばゲート電極は、Al膜に限らず、Au膜、W膜により形成することもできる。

【0111】
第2実施形態において、ゲート電極の下層に用いられるフィラーには、シリコン酸化物の他、リンガラス(PSG)、ボロンリンガラス(BPSG)等の絶縁材料を用いてもよい。

【0112】
第2実施形態、第3実施形態、第4実施形態および第5実施形態においては、Au/Ti積層膜によりソース電極、ドレイン電極を形成したが、Ti膜は必ずしも必須ではない。Auのみを蒸着してソース電極、ドレイン電極を形成することもできる。

【0113】
第4実施形態、第5実施形態においては、ダイヤモンドの積層体46を構成する第1の層47としてp型ダイヤモンド層を用いてもよい。p型ダイヤモンド層は、例えばボロン等のp型不純物源を用いて、一般的な方法により形成することができる。

【0114】
上述したとおり、本発明においては、ダイヤモンド基板の厚さ方向の領域を伝導に用いるものである。上記実施形態では、ダイヤモンド基板に設けた凹部の側面に水素化層を形成することによって、ダイヤモンド基板の厚さ方向に二次元正孔層を誘起したが、水素化層の形成方法はこれに限定されない。水素化層は、ダイヤモンド基板の厚さ方向に存在していればよく、任意の方法により形成してダイヤモンド基板の厚さ方向に二次元正孔層を誘起し、本発明の電力素子を得ることができる。
【符号の説明】
【0115】
2 :nダイヤモンド層
4 :アンドープダイヤモンド層
6,34,44 :ダイヤモンド基板
14 :ダイヤモンド膜
16 :水素化層
22a :ソース電極
22b :ドレイン電極
24 :保護膜
26a :ゲート電極
32 :pダイヤモンド層
38 :絶縁膜
30,40,50,60,70 :電力素子
図面
【図1】
0
【図2】
1
【図3】
2
【図4】
3
【図5】
4
【図6】
5
【図7】
6
【図8】
7
【図9】
8
【図10】
9
【図11】
10
【図12】
11
【図13】
12
【図14】
13
【図15】
14
【図16】
15
【図17】
16
【図18】
17
【図19】
18
【図20】
19
【図21】
20
【図22】
21
【図23】
22