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FREQUENCY MULTIPLIER

Seeds code S130012007
Posted date Jun 10, 2013
Researchers
  • (In Japanese)吉増 敏彦
  • (In Japanese)柴田 貴行
Name of technology FREQUENCY MULTIPLIER
Technology summary (In Japanese)入力回路10は、入力ノード1と中間ノードAの間に接続され、入力ノード1に入力される所定の入力信号に対し、入力信号周波数及びそのn倍周波数を含む中間信号を生成し中間ノードAに出力する。出力回路20は、中間ノードAに対して所定の入力インピーダンスを有する。共振回路6は、インダクタ4及びキャパシタ5が直列接続された構成を有し、中間ノードAに並列に接続される。この共振回路6の、共振周波数を入力信号周波数と一致させ、且つその出力インピーダンスを出力回路20の入力インピーダンスに整合させる。
Drawing

※Click image to enlarge.

thum_2010-266180.gif
Research field
  • Frequency conversion circuits
Seeds that can be deployed (In Japanese)従来の周波数逓倍器は、FETなどを用いて、その非線形性を利用して高周波を発生させる構成が一般的である。このとき、FETの出力端子を基本波で短絡するために用いるスタブ回路が長いため、回路の小型化が困難であった。これに対し、回路の小型化を可能とする周波数逓倍器を提供することを目的とする。
本発明の周波数逓倍器においては、共振回路の共振周波数を入力信号の周波数と一致させ、且つその出力インピーダンスを出力回路の入力インピーダンスと整合させたことにより、中間ノードにおいて基本波抑圧の共振回路がn倍波でのインピーダンス整合回路としても動作するため、周波数逓倍器の小型化に有効である。
Usage Use field (In Japanese)周波数逓倍器
Application patent   patent IPC(International Patent Classification)
( 1 ) (In Japanese)学校法人早稲田大学, 株式会社デンソー, . (In Japanese)吉増 敏彦, 柴田 貴行, . FREQUENCY MULTIPLIER. P2012-119819A. Jun 21, 2012
  • H03B  19/14     

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